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如何淺析UVM概念中的raise/drop objection，針對這個問題，這篇文章詳細介紹了相對應的分析和解答，希望可以幫助更多想解決這個問題的小伙伴找到更簡單易行的方法。
UVM中，component的task phase是消耗仿真時間的，各個components需要在不同層次的task phase中同步信息。
UVM中通過objection mechanism來控制phase的執行，通過raise or drop objection來決定phase中事件的開始和停止。
當程序根據phase執行順序，進入到某一個phase中時，它會收集此phase提起的所有的objection（每個component都可以raise objection）
當這個phase中所有的objection都被撤銷（drop）之后，那么這個phase就執行結束。
components或sequence將在驗證行為的開始 raise phase objection，在驗證行為完成后drop phase objection。一旦phase里所有的objection都被dropped，該phase就結束了。
考慮一個例子，agent完成讀寫操作。通常可以在sequence 或者test中添加raise/drop objection。
Objection in sequence
class wr_rd_seq extends uvm_sequence#(mem_seq_item); task pre_body(); // raise objection if started as a root sequence if(starting_phase!= null) starting_phase.raise_objection(this); endtask task body(); `uvm_do_with(req,wr_en==1); `uvm_do_with(req,rd_en==1); endtask task post_body(); // drop objection if started as a root sequence if(starting_phase!= null) starting_phase.drop_objection(this); endtaskendclass
在uvm_sequence中有一個starting_phase成員，它是uvm_phase類型。如果我們通過設置run phase的default sequence來啟動一個sequence，那么會默認將run phase的phase傳遞給這個sequence的starting_phase.
Objection in test
如果需要在test中顯式啟動sequence，即在test中添加objection。
class wr_rd_test extends uvm_test; ... task main_phase(uvm_phase phase); phase.raise_objection(); //rasing objection wr_rd_seq.start(mem_agent.sequencer); phase.drop_objection(); //droping objection endtask endclass
在test中顯式啟動sequence時， starting_phase的值是null。
關于如何淺析UVM概念中的raise/drop objection問題的解答就分享到這里了，希望以上內容可以對大家有一定的幫助，如果你還有很多疑惑沒有解開，可以關注億速云行業資訊頻道了解更多相關知識。
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